終端與業(yè)務(wù)考試EDA的特點和工程設(shè)計流程

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1.5.2 EDA的特點和工程設(shè)計流程
1、EDA進(jìn)行電子系統(tǒng)設(shè)計的特點
(1)硬件電路的設(shè)計用軟件的方式設(shè)計：
(2)設(shè)計過程可以用有關(guān)軟件進(jìn)行各種仿真，且用軟件開發(fā)的系統(tǒng)到硬件系統(tǒng)的轉(zhuǎn)換由有關(guān)的軟件自動完成：
(3)系統(tǒng)可現(xiàn)場編程，可在線升級：
(4)整個系統(tǒng)可集成在一個芯片上，體積小、功耗低、可靠性高。
2、EDA工程設(shè)計流程（舉例見第三章信號的調(diào)制和解調(diào)分析過程）
(1)源程序的編輯和編譯
可選擇三種方式：原理圖輸入方式、狀態(tài)圖輸入方式及VHDL程序的文本輸入方式；
(2)邏輯綜合和優(yōu)化；
通過綜合器(Synthesizer),將軟件描述和硬件實現(xiàn)有機(jī)結(jié)合，也就是將高級語言描述轉(zhuǎn)換為低級的，可與FPGA/CPLD或構(gòu)成ASIC的門陣列基本結(jié)構(gòu)相映射的網(wǎng)表文件；
(3)目標(biāo)器件的布線和適配
通過適配器（PlaceandRouting,P&R),將網(wǎng)表文件配置與指定的目標(biāo)文件中，產(chǎn)生最終的下載文件；
(4)編程/下載
將由FPGA/CPLD布線/適配器產(chǎn)生的配置/下載文件通過編程器或下載電纜載入目標(biāo)芯片F(xiàn)PGA/CPLD中；
(5)設(shè)計過程中的有關(guān)仿真
(6)通過仿真器（Simulator)完成設(shè)計過程中所需要的仿真，以便硬件實現(xiàn)硬件仿真/硬件測試

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