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1、狀態(tài)寄存器中的各個(gè)狀態(tài)標(biāo)志位是依據(jù)( )來(lái)置位的。
A、算術(shù)邏輯部件上次的運(yùn)算結(jié)果
B、CPU將要執(zhí)行的指令
C、CPU已執(zhí)行的指令
D、累加器中的數(shù)據(jù)
2、下列關(guān)于變址寄存器中內(nèi)容說(shuō)法正確的是( )。
A、變址寄存器內(nèi)容是由用戶(hù)確定的,在程序執(zhí)行過(guò)程中可變
B、變址寄存器內(nèi)容是由操作系統(tǒng)確定的,在程序執(zhí)行過(guò)程中不可變
C、變址寄存器內(nèi)容是由用戶(hù)確定的,在程序執(zhí)行過(guò)程中不可變
D、變址寄存器內(nèi)容是由操作系統(tǒng)確定的,在程序執(zhí)行過(guò)程中可變
3、度為3的超標(biāo)量流水線(xiàn)有5級(jí),每級(jí)流水段運(yùn)行時(shí)間均為1ns,執(zhí)行1條指令最快需時(shí)( )。
A、
B、1ns
C、3ns
D、5ns
4、在IEEE754標(biāo)準(zhǔn)規(guī)定的64位浮點(diǎn)數(shù)格式中,符號(hào)位為1位,階碼為11位,尾數(shù)為52位,則它所能表示的最小規(guī)格化負(fù)數(shù)為( )。
A、-(2-252)×2-1023
B、-(2-2-52)×2+1023
C、-1×2-1024
D、-(1-2-52)×2+2047
5、設(shè)CPU地址總線(xiàn)有24根,數(shù)據(jù)總線(xiàn)有32根,用512K×8位的RAM芯片構(gòu)成該機(jī)的主存儲(chǔ)器,則該機(jī)主存最多需要( )片這樣的存儲(chǔ)芯片。
A、256
B、512
C、64
D、128
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