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1、下列不會(huì)引起指令流水線阻塞的是( )。
A、數(shù)據(jù)旁路
B、數(shù)據(jù)相關(guān)
C、條件轉(zhuǎn)移
D、資源沖突
2、程序P在機(jī)器M上的執(zhí)行時(shí)間是20秒,編譯優(yōu)化后,Р執(zhí)行的指令數(shù)減少到原來的70%,而CPI增加到原來的1.2倍,則P在M上的執(zhí)行時(shí)間是( )。
A、8.4秒
B、11.7秒
C、14秒
D、16.8秒
3、假定編譯器將賦值語句“x=x+3;”轉(zhuǎn)換為指令“add xaddt,3”,其中xaddt是x對(duì)應(yīng)的存儲(chǔ)單元地址,若執(zhí)行該指令的計(jì)算機(jī)采用頁式虛擬存儲(chǔ)管理方式,并配有相應(yīng)的TLB,且Cache使用直寫法,則完成該指令功能需要訪問主存的次數(shù)至少是( )。
A、 0
B、1
C、2
D、3
4、某計(jì)算機(jī)有16個(gè)通用寄存器,采用32位定長(zhǎng)指令字,操作碼字段(含尋址方式位)為8位,Store指令的源操作數(shù)和目的操作數(shù)分別采用寄存器直接尋址和基址尋址方式。若基址寄存器可使用任一通用寄存器,且偏移量用補(bǔ)碼表示,則Store指令中偏移量的取值范圍是( )。
A、-32768~+32767
B、-32767~+32768
C、-65536~+65535
D、-65535~+65536
5、若某設(shè)備中斷請(qǐng)求的響應(yīng)和處理時(shí)間為100ns,每400ns發(fā)出一次中斷請(qǐng)求,中斷響應(yīng)所允許的最長(zhǎng)延遲時(shí)間為50ns,則在該設(shè)備持續(xù)工作過程中,CPU用于該設(shè)備的I/O時(shí)間占整個(gè)CPU時(shí)間的百分比至少是( )。
A、12.5%
B、25%
C、37.5%
D、50%
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