?全國2020年10月自考計算機(jī)原理02384真題

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全國2020年10月自考計算機(jī)原理02384真題

一、單項選擇題:本大題共15小題，每小題2分，共30分。在每小題列出的備選項中只有一項是符合題目要求的，請將其選出。

1.計算機(jī)通過總線將計算機(jī)硬件的五大部件連接起來，下列總線中不屬于計算機(jī)總線的是

A.數(shù)據(jù)總線

B.地址總線

C.控制總線

D.運(yùn)算總線

2.邏輯代數(shù)是用于描述客 觀事物間的邏輯關(guān)系的數(shù)學(xué)工具，于1854年提出該理論的科學(xué)家是

A.喬治.布爾

B.克勞德.香農(nóng)

C.約翰.阿塔納索夫

D.查爾斯.巴貝奇

3.對于雙向移位寄存器74LS194來說，要實現(xiàn)4位移位寄存器中的各位數(shù)碼依次向左移一位，需要滿足的條件是

A. MR=1,S1=1, S0=1

B. MR=1,S1=0, S0=1.

C. MR=1, Sl=1, S0=0

D. MR=1,S1=0, S0=0

4.程序控制類指令的功能是

A.進(jìn)行算法運(yùn)算和邏輯運(yùn)算

B.進(jìn)行內(nèi)存和CPU之間的數(shù)據(jù)傳送

C.進(jìn)行CPU和IO設(shè)備之間的數(shù)據(jù)傳送

D.控制程序的執(zhí)行順序

5. 設(shè)X=- 0.1001,則[X]為

A.1.1001

B.1.0110

C. 1.0111

D.1.1101

6.在加法器、 寄存器的基礎(chǔ)上增加部分控制電路實現(xiàn)乘除法時，用B寄存器存放

A.被乘數(shù)和被除數(shù)

B.被乘數(shù)和除數(shù)

C.乘數(shù)和被除數(shù)

D.乘數(shù)和除數(shù)

7.某8位計算機(jī)中,假設(shè)x和y是兩個帶符號整數(shù)變量,用補(bǔ)碼表示,x= 63,y=-32,則x-y的機(jī)器數(shù)和溢出標(biāo)志分別是

A.5EH, 0

B.5FH, 0

C. 5EH, 1

D.5FH, 1

8.通常情況下，CPU的組成部件不包括

A. ALU

B.控制器

C. DRAM

D.寄存器

9. CPU 嚴(yán)格按程序規(guī)定的順序來執(zhí)行指令序列，這種功能屬于

A.操作控制

B.時間控制

C.數(shù)據(jù)加工

D.程序控制

10.流水線CPU由于多條指令的重疊執(zhí)行，當(dāng)后續(xù)指令所需的操作數(shù)剛好是前一段指令的運(yùn)行結(jié)果時，會發(fā)生的沖突為

A.資源相關(guān)沖突

B.數(shù)據(jù)相關(guān)沖突

C.控制相關(guān)沖突

D.指令相關(guān)沖突

11.存儲單元是指

A.存放一個或幾個字節(jié)的二進(jìn)制信息的存儲元的集合

B.存放一個二進(jìn)制信息位的存儲元

C.存放一個字節(jié)的所有存儲元的集合

D.存放兩個字節(jié)的所有存儲元的集合

12.在主存和CPU之間增加Cache存儲器的目的是

A.增加內(nèi)存容量

B.提高內(nèi)存可靠性

C.解決CPU和主存之間的速度匹配問題

D.增加內(nèi)存容量，同時加快存取速度

13.下列輸入輸出控制方式中可采用周期挪用方式的是

A. DMA

B.中斷

C.程序傳送

D.通道

14.對外圍設(shè)備進(jìn)行編址時,不必設(shè)置專門的/O指令的編址方式是

A.獨(dú)立編址方式

B.統(tǒng)一編址方式

C.混合編址方式

D.地址映射方式

15.下列有關(guān)“中斷”的敘述中，不正確的是

A.一且有中斷請求出現(xiàn)，CPU立即停止當(dāng)前指令的執(zhí)行，轉(zhuǎn)而去受理中斷請求

B.若條件允許，CPU響應(yīng)中斷時暫停運(yùn)行當(dāng)前程序，轉(zhuǎn)移到中斷服務(wù)程序

C.中斷方式一般適用于隨機(jī)出現(xiàn)的服務(wù)

D.為了保證中斷服務(wù)程序執(zhí)行完畢以后，能正確返回到被中斷的斷點(diǎn)繼續(xù)執(zhí)行程

序，必須進(jìn)行現(xiàn)場保存操作

二、填空題:本大題共10小題，每小題2分,共20分。

16.1939 年，美國依阿華大學(xué)教授約翰.阿塔納索夫首次使用電子元件按           原理制造了一臺電子計算機(jī)。

17.在時序邏輯電路中，構(gòu)成各種復(fù)雜時序邏輯電路的基本部件是          

18.十進(jìn)制83.5對應(yīng)的BCD碼表示為          

19.補(bǔ)碼減法器計算兩個數(shù)差的補(bǔ)碼是可用          得到。

20.補(bǔ)碼一位乘法為了避免中間結(jié)果溢出，被乘數(shù)、部分積取          參加運(yùn)算，部分積初值為0。

21.現(xiàn)代CPU主要由運(yùn)算器、          和Cache三大部分組成。

22.給計算機(jī)各功能部件提供工作時所需的時間標(biāo)志的是          

23. CPU能直接訪問          和主存，但不能直接訪問磁盤和光盤。

24.計算機(jī)系統(tǒng)中，根據(jù)應(yīng)用條件和硬件資源不同，數(shù)據(jù)傳送方式可采用:并行傳送和          傳送。

25.DMA技術(shù)的出現(xiàn)使得外圍設(shè)備可通過          直接訪問內(nèi)存。

三、計算題:本大題共5小題，每小題4分，共20分。

26.寫出如圖所示電路的邏輯表達(dá)式，并列出真值表。

27. [X]補(bǔ) =(1.1000111)2，求X。

28.已知x=- 110110, y=-011011, 用變形補(bǔ)碼(雙符號位)計算x+y,并判斷運(yùn)算結(jié)果是否溢出。

29.假設(shè)一條指令的指令周期為取指令、指令譯碼、執(zhí)行指令三個子過程段，且這三個子過程延遲時間相等，即每個子過程延遲時間都為T。假設(shè)某程序共有n= 8000條指令，寫出指令順序執(zhí)行方式下CPU執(zhí)行該程序所需的總時間。

30. CPU執(zhí)行一 段程序時，Cache 完成存取的次數(shù)為3800次，主存完成存取的次數(shù)為200次，已知Cache存取周期為50ns，主存為250ns,求Cache /主存系統(tǒng)的效率。

(計算結(jié)果保留1位小數(shù))

四、問答題:本大題共6小題，每小題5分，共30分。

31.什么是觸發(fā)器?按功能來分，常見的觸發(fā)器有哪幾種?

32.簡述變址尋址的基本原理,并說明指令MOV CL, [SI+ 1024H]的尋址過程。

33.原碼恢復(fù)余數(shù)除法的運(yùn)算規(guī)則是什么?

34.寫出CPU的至少五個功能。

35.有一個16Kx16位(bit) 的存儲器，由1Kx16位(bit) 的DRAM芯片構(gòu)成，問：

(1) 總共需要多少DRAM芯片?

(2)畫出存儲體的示意圖。

36.說明程序查詢方式與中斷方式各自的特點(diǎn)。